ریسک پنج

طراحی پردازنده به مهارت طراحی در چندین تخصص نیاز دارد: منطق الکترونیکی دیجیتال، کامپایلرها و سیستم عامل‌ها. برای تأمین هزینه‌های چنین تیمی، فروشندگان تجاری طراحی‌های رایانه ای، مانند ARM Holdings و MIPS Technologies هزینه ای بابت حق استفاده از طرح‌ها، حق ثبت اختراع و حق تکثیر می‌گیرند. آنها همچنین اغلب قبل از انتشار اسنادی که مزایای دقیق طرحهای آنها را شرح می‌دهد، به توافق‌نامه عدم افشای اطلاعات احتیاج دارند. در بسیاری از موارد، آنها هرگز دلایل انتخاب خود را توضیح نمی‌دهند.

ریسک پنج با هدف ساخت یک ISA عملی آغاز شد که دارای منابع آزاد باشد، از نظر علمی و در هر طراحی سخت‌افزاری یا نرم‌افزاری بدون حق امتیاز قابل استفاده باشد. همچنین، منطق هر قسمت از پروژه، حداقل به‌طور کلی توضیح داده شده‌است. طراحان ریسک پنج دانشگاهی هستند اما در طراحی کامپیوتر تجربه قابل توجهی دارند. ریسک پنج پروژه ای از مجموعه پروژه‌های دانشگاه برکلی در حوزه طراحی رایانه است. بخشی از آن برای کمک به چنین پروژه‌هایی ایجاد شده‌است.

به منظور ایجاد یک جامعه گسترده و مداوم از کاربران و در نتیجه جمع‌آوری طرح‌ها و نرم‌افزارها، طراحان ریسک پنج قصد داشتند از طیف گسترده‌ای از کاربردهای عملی پشتیبانی کنند: پیاده‌سازی‌های کوچک، سریع و کم مصرف.

طراحان می‌گویند که مجموعه دستورالعمل‌ها رابط اصلی رایانه است زیرا بین سخت‌افزار و نرم‌افزار قرار دارد. اگر یک مجموعه دستورالعمل خوب باز باشد، همه برای استفاده در دسترس باشند، باید با اجازه استفاده مجدد بیشتر هزینه نرم‌افزار را به طرز چشمگیری کاهش دهد. همچنین باید رقابت بین ارائه دهندگان سخت‌افزار، که می‌توانند از منابع بیشتری برای طراحی استفاده کنند و هزینه کمتری برای فراهم کردن پشتیبانی نرم‌افزار بپردازند، افزایش یابد.

طراحان ادعا می‌کنند که اصول جدید در طراحی مجموعه دستورالعمل‌ها به مرور نادر شده‌اند، زیرا موفق‌ترین طراحی‌های چهل سال گذشته به‌طور فزاینده ای شبیه به هم شده‌اند. افرادی که شکست خوردند، بیشتر به دلیل این بوده‌است که شرکت‌های حامی مالی آنها از نظر تجاری شکست خوردند، نه به این دلیل که مجموعه دستورالعمل‌ها از نظر فنی ضعیف بودند؛ بنابراین، یک مجموعه دستورالعمل باز کاملاً طراحی شده با استفاده از اصول کاملاً ثابت باید پشتیبانی طولانی مدت بسیاری از فروشندگان را جلب کند.

ریسک پنج همچنین برای کاربردهای علمی و دانشگاهی مناسب است. سادگی زیرمجموعه عدد صحیح اجازه تمرینات پایه دانشجویی را می‌دهد. زیرمجموعه عدد صحیح یک ISA ساده است که قادر است ماشین‌های تحقیق را کنترل کند. ISA با طول متغیر برنامه‌های افزودنی را برای تمرین دانشجویی و تحقیق امکان‌پذیر می‌کند. مجموعه دستورالعمل‌های ممتاز لوازم تحقیق در مورد پشتیبانی سیستم عامل، بدون طراحی مجدد کامپایلرها را فراهم می‌کند. مالکیت معنوی باز ریسک پنج اجازه می‌دهد تا طرح‌های آن منتشر، استفاده مجدد و اصلاح شود.

ISA پایه و افزونه‌ها

ریسک پنج دارای یک طراحی مدولار، متشکل از قطعات پایه متنوع، با افزونه‌های اختیاری اضافه شده‌است. ISA پایه و افزونه‌های آن در یک تلاش جمعی بین صنعت، جامعه تحقیقاتی و موسسات آموزشی توسعه یافته‌است. دستورالعمل‌های پایه (و کدگذاری آنها)، جریان کنترل، رجیسترها (و اندازه آنها)، حافظه و آدرس دهی، منطق (یعنی عدد صحیح) را دستکاری می‌کند و سایر موارد جانبی را مشخص می‌کند. این پایگاه به تنهایی می‌تواند یک رایانه ساده با اهداف عمومی را با پشتیبانی کامل از نرم‌افزار، از جمله یک کامپایلر عمومی، پیاده‌سازی کند.

افزونه‌های استاندارد برای کار با همه پایه‌های استاندارد و بدون تعارض با یکدیگر مشخص شده‌اند.

بسیاری از رایانه‌های ریسک پنج ممکن است افزونه فشرده سازی را برای کاهش مصرف برق، اندازه کد و استفاده از حافظه اجرا کنند. همچنین برنامه‌هایی در آینده برای پشتیبانی از hypervisors و مجازی سازی وجود دارد.

• RISC
• معماری ARM
• برکلی ریسک

• "The RISC-V Instruction Set Manual". RISC-V.
• "RISC-V Assembly Language Programming". GitHub. 8 November 2019.
• "Design of the RISC-V Instruction Set Architecture" (PDF). EECS Department, University of California, Berkeley.
• Asanović, Krste; Patterson, David A. (6 August 2014). "Instruction Sets Should Be Free: The Case For RISC-V". EECS Department, University of California, Berkeley. UCB/EECS-2014-146.
• Waterman, Andrew; Lee, Yunsup; Avizienis, Rimas; Cook, Henry; Patterson, David A. ; Asanović, Krste (25–2۷ اوت ۲۰۱۳). The RISC-V Instruction Set (PDF). Hot Chips 25. Stanford University, Palo Alto, California, USA.
• Dabbelt, Palmer (7–1۱ فوریه ۲۰۱۵). RISC-V Software Ecosystem (PDF). High-Performance Computer Architecture (HPCA) 2015. San Francisco, California, USA.
• Lee, Yunsup (7–1۱ فوریه ۲۰۱۵). RISC-V "Rocket Chip" SoC Generator in Chisel (PDF). High-Performance Computer Architecture (HPCA) 2015. San Francisco, California, USA.
• Waterman, Andrew; Lee, Yunsup; Patterson, David A.; Asanović, Krste (5 November 2015). "The RISC-V Compressed Instruction Set Manual Version 1.9 (draft)" (PDF). RISC-V.

• وبسایت رسمی
• مرجع مجموعه دستورالعمل‌های RISC-V
• "RISC-V: An Open Standard for SoCs: The case for an open ISA". EETimes. 8 July 2014.
• Hruska, Joel (21 August 2014). "RISC rides again: New RISC-V architecture hopes to battle ARM and x86 by being totally open source". ExtremeTech.
• "Analyzing the RISC-V Instruction Set Architecture". Adapteva. 11 August 2014.